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慶應義塾大学 
理工学部 
情報工学科 

顔写真 教授 
天野 英晴 
アマノ ヒデハル 
AMANO HIDEHARU 

1958年生まれ  
http://www.am.ics.keio.ac.jp/  

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学歴
慶應義塾大学  工学部  電気工学科  1981/03/31  卒業 
慶應義塾大学  工学研究科  電気工学専攻  修士  1983/03/31  修了 
慶應義塾大学  工学研究科  電気工学専攻  博士  1986/03/31  修了 

学位
工学   慶應義塾大学  1986/03/31 

学術受賞歴(賞、称号)
電子情報通信学会フェロー  2015/09/09 
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研究分野
計算機科学 

研究テーマ
並列計算機アーキテクチャ リコンフィギャラブルシステム  SAN用相互結合網、PCクラスタ用ネットワークRHiNET 仮想ハードウェア、動的適応ハードウェア、DRP 

研究業績(著書)
FPGAの原理と構成  天野 英晴(編)、飯田全広他14人  オーム社  2016/04/30 
ディジタル回路設計とコンピュータアーキテクチャ ARM版  天野 英晴  SiBアクセス  2016/04/01 
コンピュータアーキテクチャ 定量的アプローチ  J.L.Hennessy and D.A.Patterson  翔泳社  2014/03 
CMOS VLSI回路設計  N.H.E.Weste, D.M.Harris  10章、付録  丸善出版  2014/01 
マンガでわかるディジタル回路  天野 英晴  オーム社  2013/12 
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研究業績(原著論文・解説)
研究論文(学術雑誌)  共著  Power Optimization Methodology for Ultra Low Power Microcontroller with Silicon on Thin BOX MOSFET  天野 英晴  IEEE Trans. on VLSI Systems  25/ 4, 1578-1582  2017/04  10.1109/TVLSI.2016.2635675 
研究論文(国際会議プロシーディングス)  共著  NAMACHA: A software edevelopment environment for a mutli-chip convolutional network accelerator  天野 英晴  CATA2017,  2017/03 
研究論文(学術雑誌)  共著  Scalable Networks-on-Chip with Elastic Links Demarcated by Decentralized Routers  天野 英晴  IEEE Trans. on Computers  66/ 4, 702-716  2017/03  10.1109/TC.2016.2606567,2017 
研究論文(国際会議プロシーディングス)  共著  High-Bandwidth Low-Latency Approximate Interconnection Networks  天野 英晴  Proc. of the 23rd IEEE International Symposium on High-Performance Computer Architecture (HPCA'17)  2017/02 
研究論文(国際会議プロシーディングス)  共著  An Inductive-Coupling Bus with Collision Detection Scheme Using Magnetic Field Variation for 3-D Network-on-Chips  天野 英晴  Proc. of ASSCC2016  2016/12 
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研究業績(口頭・ポスター発表)
口頭発表(一般)  Zynq Cluster for CFD Parametric Survey  the International Symposium on Applied Reconfigurable Computing (ARC)  2016/02 
口頭発表(一般)  Randomizing Packet Memory Networks for Low-latency Processor-memory Communication  The 24th Euromicro International Conference on Parallel, Distributed and Network-Based Processing (PDP)  2016/02 
口頭発表(一般)  Power Optimization considering the chip temperature of low power reconfigurable accelerator CMA-SOTB  he 4rd International Symposium on Computing and Networking (CANDAR)  2015/12 
口頭発表(一般)  A 297MOPS/0.4mW Ultra Low Power Coarse-grained Reconfigurable Accelerator CMA-SOTB-2  The 10th International Conference on ReConFigurable Computing and FPGAs  2015/12 
口頭発表(一般)  On-Chip Decentralized Routers with Balanced Pipelines for Avoiding Interconnect Bottleneck  the 9th ACM/IEEE International Symposium on Networks-on-Chip (NOCS)  2015/10 
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受賞歴(賞、称号)
ISS功績賞  2014/05 
論文賞  Network-on-ChipにおけるFat H-Treeトポロジに関する研究  2008/05/01 
論文賞  DRL上への仮想ハードウェアの実装  2003/05/01 
情報処理学会坂井記念学術賞  1997 
情報処理学会論文賞  「多重出力可能なMINの性能評価」により  1995 
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社会活動
ASP Design Automation Conference 2000  1998-現在 
Cool Chips 1999  1998-現在 
Japanese FPGA/PLD Conference and Exhibit  1998-現在 
ASP Design Automation Conference 1998  1997-現在 
IASTED International Conference of Applied Informa  1997-1998 
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所属学協会
電子情報通信学会コンピュータシステム研究専門委員会  2011/05/01-現在 
First international workshop on highly-efficient accelerators and reconfigurable technologies (HEART)  2010-現在 
Cool Chips  2009-現在 
International Symposium on Applied Reconfigurable Computing  2008/03/01-現在 
International Conference on Field Programmable Technology  2007/12/01-現在 
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委員歴
電子情報通信学会、情報処理学会  FIT実行委員長  2015/05-現在 
電子情報通信学会  ISS副会長  2015/05-現在 
情報処理学会  全国大会プログラム委員長  2015/05-2016/03 
電子情報通信学会コンピュータシステム研究専門委員会  専門委員長  2011/05/01-2013/05 
電子情報通信学会リコンフィギャラブルシステム研究会  専門委員長  2006/05/01-2007/04/30 
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